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1.JK D触发器 真值表
原发布者：yarser
D触发器真值表分析：1.D触发器真值表2.考虑“清零”和“预置”后的D触发器真值表3.D触发器的布尔方程：DT:=D*/CLR+PR DC:=/D*/PR+CLRJK触发器1.JK触发器真值表2.考虑“清零”和“预置”后的JK触发器真值表3.JK触发器的布尔方程：JKT:=J*/JKT+/K*JKT JKC:=/J*/JKC+K*JKCRS触发器1.RS触发器真值表2.考虑“清零”和“预置”后的RS触发器真值表3.RS触发器的布尔方程：SRT:=S+/R*SRTSRC:=R+/S*SRCT触发器1.T触发器真值表2.考虑“清零”和“预置”后的T触发器真值表3.T触发器的布尔方程：TT:=T*/TT+/T*TTTC:=T*/TC+/T*TC
2.JK D触发器 真值表
D触发器1. D 触发器真值表 Dn Qn+1 0 0 1 1 2. 考虑 “ 清零 ” 和 “ 预置 ” 后的 D 触发器真值表 清零 （CLR=1） 预置 （PR=1） 无预置（PR=0） 无清零（CLR=0） DT:=D*/CLR+PR 0 1 DC:=/D*/PR+CLR 1 0 3. D 触发器的布尔方程： DT : = D * /CLR + PR DC : = /D * /PR + CLR JK触发器1.JK 触发器真值表 J K Qn+1 0 0 Qn 0 1 0 1 0 1 1 1 /Q 2. 考虑 “ 清零 ” 和 “ 预置 ” 后的 JK 触发器真值表 J K JKT 0 0 JKT 0 1 0 1 0 1 1 1 /JKT 3.JK 触发器的布尔方程：JKT : = J * /JKT + /K * JKT JKC : = /J * /JKC + K * JKC RS触发器1. RS 触发器真值表 R S Qn+1 0 0 1 0 1 0 1 0 Qn 1 1 X 2. 考虑 “ 清零 ” 和 “ 预置 ” 后的 RS 触发器真值表 R S SRT 0 0 SRT 0 1 1 1 0 0 1 1 X 3. RS触发器的布尔方程： SRT:= S + /R * SRTSRC:= R + /S * SRCT触发器1. T触发器真值表 Tn Qn+1 0 Qn 1 /Qn 2.考虑“清零”和“预置”后的T触发器真值表 T TT 0 TT 1 /TT 3.T触发器的布尔方程：TT:= T * /TT + /T * TTTC:= T * /TC +/T * TC声明：转自：/blog/static//。
3.测试D触发器的逻辑功能（74LS74）
D触发器的逻辑功能：Qn+1=D。
D触发器是一个具有记忆功能的，具有两个稳定状态的信息存储器件，是构成多种时序电路的最基本逻辑单元，也是数字逻辑电路中一种重要的单元电路。
在数字系统和计算机中有着广泛的应用。触发器具有两个稳定状态，即"0"和"1"，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。
触发器有集成触发器和门电路组成的触发器。触发方式有电平触发和边沿触发两种，前者在CP（时钟脉冲）=1时即可触发，后者多在CP的前沿（正跳变0→1）触发。
D触发器的次态取决于触发前D端的状态，即次态=D。因此，它具有置0、置1两种功能。
对于边沿D触发器，由于在CP=1期间电路具有维持阻塞作用，所以在CP=1期间，D端的数据状态变化，不会影响触发器的输出状态。
D触发器应用很广，可用做数字信号的寄存，移位寄存，分频和波形发生器等等。
扩展资料
D触发器由4个与非门组成，其中G1和G2构成基本RS触发器。电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。而边沿触发器允许在CP触发沿来到前一瞬间加入输入信号。
这样，输入端受干扰的时间大大缩短，受干扰的可能性就降低了。边沿D触发器也称为维持-阻塞边沿D触发器。边沿D触发器可由两个D触发器串联而成，但第一个D触发器的CP需要用非门反向。
参考资料来源：百度百科-D触发器
4.用下降沿触发的D触发器设计同步时序电路,电路状态如下图请写出设
D触发器的驱动方程是 ：Qn+1 = D ，从状态转换图做出真值表时，就不必要写 Qn+1 的项目： Q2 Q1 Q0 Y D2 D1 D0 0 0 0 0 0 0 1 0 0 1 0 0 1 1 0 1 1 0 1 1 1 1 1 1 0 1 1 0 1 1 0 0 1 0 0 1 0 0 1 0 0 0 从真值表做出逻辑表达式：Y = Q2Q1'Q0'D2 = Q2'Q1Q0 + Q2Q1Q0 + Q2Q1Q0' = (Q2' + Q2)Q1Q0 + Q2Q1Q0 = (1 + Q2) Q1Q0 = Q1Q0D1 = Q2'Q1'Q0 + Q2'Q1Q0 + Q2Q1Q0 = Q2'Q1'Q0 + (Q2' + Q2)Q1Q0 = Q2'Q1'Q0 + Q1Q0 = (Q2'Q1'+ Q1) Q0 = (Q2' + Q1) Q0D0 = Q2'Q1'Q0' + Q2'Q1'Q0 + Q2'Q1Q0 = Q2'Q1'(Q0' + Q0) + Q2'Q1Q0 = (Q1' + Q1'Q0) Q2' = (Q1' + Q0) Q2'Y = Q2Q1'Q0'逻辑化简、电路图你要核对一下.。
真值表怎么写
1. 根据真值表写出逻辑函数的原理是什么
上述概念都是【逻辑代数】中的内容。【逻辑代数】是【数学】与【逻辑学】相结合的产物。【逻辑代数】中的内容，都可以在其中找到原始的解释：
1、数学解释：
【逻辑函数】是数学函数的一种，表示的是【逻辑变量】——取值范围为{0,1}的变量——间的对应关系。这种关系是通过【逻辑运算】建立的，所以，【逻辑函数】的一切性质，都是由【逻辑变量】和【逻辑运算】决定的。先说说【逻辑运算】：
①：【与——逻辑乘】：Y=X1·X2·……·Xk;(k个逻辑变量连乘)
表示：Y=1，当且仅当 X1、X2、……、Xk【全部等于1】；
②：【或——逻辑加】：Y=X1+X2+……+Xk;(k个逻辑变量连加)
表示：Y=1，当且仅当 X1、X2、……、Xk【至少一个等于1】；
③：【非——逻辑非】：Y=X′；（我用X′表示：X的非）
表示：Y=1，当且仅当 X【等于0】；
逻辑函数的通用表达式为：
Y=f(X1,X2，……，Xk)；——k元逻辑函数；
在【真值表】中，k元逻辑函数必然恰好具有：2^k行。我们用：
v=(x1,x2，……，xk)
来表示真值表某一行中全部自变量的【赋值组合】。 那么该行对应的函数值可记作：
Y=f(v);
我们知道，自变量的【赋值组合】唯一确定了Y的取值。根据每行中Y的不同取值（0或1），可将每行所对应的【赋值组合】分为两组：
A组：Y=1；记作：A={a1,a2，……，am}；——设共有m行；
B组：Y=0；记作：B={b1,b2，……，bn}；——设共有n行；
显然：m+n=2^k；并且：
Y=f(a1)=f(a2)=……=f(am)=1;
Y=f(b1)=f(b2)=……=f(bn)=0;
另外，因为每个【赋值组合】都要取遍所有自变量，那么，每行的【赋值组合】必然可以对应一个【最小项】，构造规则如下：
①：如果Xi=1；则使用【正变量】——Xi;
②：如果Xi=0；则使用【反变量】——Xi′；
根据【逻辑乘】和【逻辑非】的运算性质，可知：使用此方法构造最小项，必然具有以下性质：
【1】可以构造出k个变量的全部【最小项】，它们恰好分别对应【真值表】中的每一行；
【2】每个【赋值组合】，恰好也是【唯一的】可以使相应【最小项】等于1的【赋值组合】；
根据【2】所确定的【赋值组合】与【最小项】间的一一对应关系，我们将该【逻辑函数】的所有的【最小项】也分为两组：
M={A1,A2，……，Am};
N={B1,B2，……，Bn};
其中的每个元素都是一个个的【最小项】；并且，我们规定M、N中元素的下标，与A、B中所对应的元素的下标是一致的。
现在，我们可以确定这样一种关系了：
Y=f(v)=1;
当且仅当：v∈A;
当且仅当：存在ai=v∈A;(i是一个不确定的下标)
当且仅当：Ai=1；显然：Ai∈M;
当且仅当：所有Aj=Bl=0；其中：Aj∈M且j≠i;Bl∈N;(j和l都是下标)
这也就是说：
Y=1；当且仅当：M中【至少（事实上，也是恰好）有1个】最小项也等于1。
再根据【逻辑加】的运算性质，可知，Y必然满足以下等式：
Y=A1+A2+……Am;
这，就是该【逻辑函数】的【标准与或式】。也就是根据【真值表】直接写出来的【逻辑表达式】。
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